采用ARM9处理器和GPRS模块设计通用远程监测终端系统

电子设计 2018-11-06 09:10 次阅读

随着现代生产科技水平的发展,对监测技术的要求越来越高,形式趋于多样化。在无人值守的变电站、水文站、气象站等野外监测或是在交通运输等行业中,因分布比较分散、环境恶劣,地点不固定,不便于用传统方法实现集中控制和实时监测并且有线网络的架设受到种种限制。在这些场合采用基于GPRS的无线网络通信技术,具有无可比拟的优势。将嵌入式应用系统与无线通信技术结合在一起是未来嵌入式应用的必然趋势。GPRS(General Packet Radio Service),即通用无线分组业务。

GPRS技术应用于远程数据传输系统,具有以下几个特点:1)永远在线,接入速度快。分组交换接入时间少于1秒,可使远程数据传输的效率大大提高:2)采用数据流量的计费方式,大大降低了用户的使用费用;3)GPRS网络覆盖范围广,且支持TCP/IP协议,从而可实现与Intern et的无缝连接。

1 终端的整体结构设计

终端要完成3个任务,数据采集、数据处理和数据的无线传输。数据采集部分采用模块化设计思想将采集模块分为模拟量采集模块,数字量采集模块,开关量采集模块等,每个模块独立的实现对特定采集信号的整流、调理、隔离等处理再转换为数字量,各模块采用统一的结构,选用相同的单片机处理器。各模块采集的数据通过统一的SPI(serialperipleral interface)总线传输给ARM处理器。这样的结构使终端使用更灵活,应用范围更广泛。数据处理部分采用ARM处理器对所采集的数据的类型、长度、有效范围等进行处理,并通过液晶屏加触摸屏完成人机交互功能。然后将处理好的数据通过GPRS无线网络传输给上位机。终端的整体结构图如图1所示。

采用ARM9处理器和GPRS模块设计通用远程监测终端系统

图1 终端的整体结构图

2 终端硬件设计

终端硬件主要由3部分组成。一是作为主处理器的ARM9处理器及其外围电路包括电源电路、复位电路、外扩存储器电路及用于人机互动的液晶屏、触摸屏连接电路等。二是各个模块的数据采集电路的设计,这里主要设计的是模拟量采集模块,以及各个数据采集模块与主处理器之间SPI连接方式。三是GPRS模块外围电路以及与主处理器的连接。端硬件设计示意图如图2所示。

采用ARM9处理器和GPRS模块设计通用远程监测终端系统

图2 系统硬件结构示意图

2.1 终端主处理器

主处理器是系统的核心,要完成数据处理,存储,传输,人机界面显示等功能。结合工业现场的需求终端处理器采用以ARM9为内核的三星S3C2440处理器,它是一款基于ARM920T内核的16/32位RSIC结构的嵌入式微处理器,主频400 MHz,最高可达533 MHz,具有2片外接32 M的板载SDRAM,片内外资源丰富,扩展性强。系统存储扩展了2 MB的NorFlash用于存放bootloader系统引导程序,和64 MB的NandFlash.系统的人机交互平台采用一个7寸液晶显示频和一个触摸屏来完成。

2.2 数据采集部分硬件设计

数据采集模块可分为模拟量采集模块,数字量采集模块,开关量采集模块等,主要完成对底层数据的采集,这些模块的单片机处理器统一采用Cygnal公司的C8051F021单片机,它的MCU是高度集成的片上系统。在一个芯片内集成了两个多通道ADC子系统、电压基准、SPI总线接口、8个8位的通用数字I/O端口和64 kBFLASH程序存储器及与8051兼容的高速微控制器内核等,这些很好的满足了模块的设计要求。由于模块设计结构上的相似性,这里主要介绍模拟量采集模块部分。

工业现场采集的信号大部分是模拟量,如压力、温度、液位、流量等信号。这些信号经过现场仪表测量后一般统一输出为4~20 mA,0~5 V,0~10 V范围的电流电压信号。通过模拟量采集模块将这些模拟量转换为数字量。单片机的A/D准换的电压基准定为2.5 V,要将4~20 mA,0~5 V,0~10 V范围的电流电压信号统一为0~2.5 V以内的电压信号,才能进入单片机完成模拟量到数字量的转换。对于电流信号,在输入端接一个250 Ω的精密便转换为1~5 V的电压信号了,对于电压信号通过运算放大器按比例缩放到0~2.5 V范围内即可。转换电路如图3所示。

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图3 电压信号转换澳门威尼斯手机版

各个数据采集模块与主处理器通过SPI总线进行通信。SPI总线是Motorola公司提出的一种高速全双工串行通信总线,它容许CPU与各种外围接口器件以串行方式进行通信。SPI接口只有MISO(主入从出)、MOSI(主出从人)、SCLK(时钟)和CS(片选)4个信号组成,在芯片上只占用4条线,大大节省了芯片资源。主处理器与各采集模块的SPI通信方式为一主多从的方式,即ARM主处理器的作为主设备,各数据采集模块作为从设备,主设备驱动串行时钟发起通信。主设备使用片选信号CS指明与哪个模块采集模块传送数据。通信时,主设备的MISO为输入,MOSI为输出,从设备的MISO为输出,MOSI为输入,在主设备时钟的控制下,主设备与从设备的双向移位寄存器同时进行数据交换,完成一次数据的传输。主处理器与各模块的通信结构图如图4所示。

采用ARM9处理器和GPRS模块设计通用远程监测终端系统

图4 SPI通信结构图

2.3 GPRS模块

GPRS模块选用华为GTM900C模块,它是一款三频段GSM/GPRS无线模块。模块接口简单、使用方便且功能强大。它支持标准的AT命令及增强AT命令。GTM900C的GPRS数据业务的最高速率可达85.6 kbit/GTM900C提供40脚的ZIF接口,主要有电源接口、UART接口(最大串口速率可达115200bit/s)、标准SIM卡接口和模拟语音接口。

本系统中,GTM900C主要是实现GPRS上网功能。该模块的主要特点如下:

1)单电源供电,供电范围为3.3~4.8 V.典型供电电压为4.2 V;

2)可工作于三频EGSM900和/GSM1800/GT800单频;最大发射功率EGSM900/GT800 Class(2W)和GSM1800 Classl(1W);

3)支持GSM标准AT命令、V.25 AT命令和华为扩展AT命令;

4)GPRS传输速率最高可达85.6 kbps,支持CS-1,CS-2,CS-3,CS-4 4种编码方式。内嵌了TCP/IP协议;支持多连接,提供ACK应答,提供大容量缓存。

GPRS模块与主处理器的连接很简单,由于两者是通过串口接口进行通信的,所以将两者用串口线连接即可。GPRS的网络功能都已集成在模块中,只需要在主处理器这一端将串口参数设置好,然后发送相应的AT指令对模块进行操作即可。

3 终端软件设计

终端软件设计包括两个任务,一是搭建开发环境,如Linux操作系统内核移植,编写设备驱动等,二是在开发环境准备好的基础上进行应用程序的编写,包括完成SPI总线数据输入输出功能,GPRS无线数据传输功能,和界面显示功能。

3.1 软件开发平台搭建

软件平台采用嵌入式Linux操作系统,嵌入式Linux操作系统是一个源代码公开的实时多任务操作系统,可应用于多种硬件平台,可根据需要定制内核,有良好的网络支持,Linux系统内核精简、高效并且稳定,能够充分发挥硬件的功能,它非常适合在嵌入式领域中应用。嵌入式Linux操作系统搭建的步骤为:在宿主机上建立交叉编译的环境;编译生成Linux的内核,用的内核是Linux-2.6.29;编译生成根文件

系统,用的根文件系统为yaffs;向目标机下载Bootloader的映像,用的Bootloader为Supervivi;烧写Linux内核和文件系统的映像;复位启动。为了使终端可以使用触摸屏,液晶屏和SPI总线,将编写的对应的驱动编译、添加到Linux内核中。系统使用的宿主机系统为在虚拟机下运行的RedHat9.0.

终端应用程序用Qt来编写,Qt是一个跨平台的C++图形用户界面应用程序框架。它具有优良的跨平台特性、面向对象、丰富的API支持等优点。Qt-Embedded是Qt的嵌入式版本,因此终端应用程序的开发使用Qt/E作为开发工具。Qt运行环境的搭建步骤为:首先在宿主机上分别建立Ot-x86编译环境和Qt-ARM编译调试环境,采用Qt4.5.0版本;其次,将宿主机生成的Lib下的库文件下载到目标板的某个目录下,并在目标板上设置好环境变量,这样在目标机上的Qt程序运行环境就建好了。在宿主机上交叉编译好的Ot/E程序就可以下载到目标机上运行了。

3.2 终端应用程序设计

监测终端需要采集监测仪表的现场测量数据,终端设计的数据采集模块分别对不同的现场数据进行采集并做相应的处理,数据采集模块与CPU之间通过SPI总线进行数据传输,对与采集数据需按上端通信协议、PPP、TCP/IP协议进行二次成帧;利用GPRS网络接入Internet网络,将处理后的数据信息通过GPRS无线网络上传至监控中心。

GPRS模块附着GPRS网络并与上位机建立TCP数传链路是通过向模块发送一串AT指令实现。拨号动作完成,并成功建立数传链路以后,GPRS模块在终端串行口和上位机之间变得透明。另外,终端的重要状态要能即时显示在LCD上。

综上分析,监控终端应用程序要完成的任务有:串口参数设置,GPRS网络连接,读取串口返回信息,SPI数据传输,GPRS数据传输,界面显示。由于任务不止一个,而且有的任务需要同时运行,所以采用多线程编程。

在Qt编程中主界面UI一般为主线程,子线程通过继承Qt中的QThread线程类来完成。这些任务和功能可以通过3个线程来实现。3个线程的作用分别为:1)主线程:负责界面显示,串口参数设置,GPRS网络连接,GPRS数据传输;2)SPI数据传输子线程:负责与数据采集模块通信,将采集数据存入缓冲区;3)串口数据读取子线程:CPU通过串口操作GPRS模块,GPRS模块的返回信息可以通过串口数据读取子线程随时读取。程序模块图如图5所示。

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图5 终端应用程序结构图

3.2.1 显示界面模块

界面显示模块:界面显示由两部分组成。一是实时显示各模块的采集数据及一定时间以内的历史数据数据;二是显示GPRS模块设置界面,通过这个界面设置串口参数、设置数据采集时间间隔、设置主机IP地址及端口号、发送AT指令、回显模块返回信息等。编写界面设计文件mainwindow.h和mainwindow.cpp,其中串口参数设置、网络连接和GPRS数据传输封装成相应的子函数,利用Qt的信号槽机制,当捕捉到

相应的信号便执行对应的函数。通过继承Qt中的QThread线程类来完成GPRS数据读取模块和SPI模块的功能。SPI模块接收底层数据采集模块的各种数据,显示到界面并编码通过GPRS通道传输到上位机,GPRS返回的一些重要信息业需显示到LCD界面上。

3.2.2 GPRS网络连接任务

GPRS网络连接任务主要完成通过GPRS网络建立与上位机的数据传输链路的过程。启动GTM900C后,首先,需对PPP连接所使用的物理串口进行初始化,包括确定用于PPP连接的串行端口号以及通信波特率。然后,直接使用AT指令,拨号到中国移动的GPRS节点服务器(GGSN)。使用以下几条灯指令使GTM900C进入数据通讯状态:

"AT+CGATY?"用于查询GTM900C是否已附着在中国移动的GPRS网络,GTM900C将返回当前状态;

"AT+CGATT=1"用于设置GTM900C附着于中国移动的GPRS网络,操作成功GTM900C将返回OK;

"A1,+CGDCONT=1,"IP""CMNET""用于设置中国移动的GPRS节点服务器的名称和属性,操作成功则返回OK;

"AT%ETCPIP"用于实现PDP激活和TCP/IP的初始化,使模块进入TCP/IP功能,操作成功返回OK;

"AT%IOMODE=0.2,0"设置数据传输模式,操作成功返回OK;

"AT%IPOPEN=1,"TCP","115.24.116.19",50001026"打开一条TCP/IP链接,选择TCP传输,115.24.116.19为上位机IP地址,5000为上位机接受程序端口号,成功与上位机连接返回CONNECT.另外模块还具有数据透传功能,数据透明传输功能将实现TCP/IP上直接数据传输,进入透传模式的AT指令是:"AT%TPS=1,1,3000,1024",进入透传模式后模块将不会相应其它AT指令,直接通过串口写入数据便可实现与上位机之间的数据传输。以上使模块附着在GPRS网络的过程封装在gprsConnect()函数中。

PPP配置、认证通过以后,即应用程序就已经通过GTM900C成功进入了Internet网络。最后,通过变量GPRSOK=1指示GPRS拨号成功并建立数传状态。在run()程序中隔一段时间判断当前网络连接状态,若网络断开则变量GPRSOK=0,并调用gprsConnect()函数开始拨号任务重新建立数传链路。

3.2.3 SPI数据通信模块

SPI通信程序包括两部分,一是用于数据采集的单片机这边需要通过SPI发送现场数据,接收控制指令,二是ARM主控制器需要读取数据,发送控制指令。数据采集模块使用是带有SPI接口的C8051f020单片机,SPI的数据寄存器是SHODAT.单片机和主控制器的SPI通信参数设置要一致。

在主设备ARM这边,SPI驱动已经配置好,直接使用read(),write()等函数便可进行数据的读取与接收。在单片机这边采用中断的方式进行SPI数据的发送与接收。对于从设备C8051f021单片机来说,只有将片选线线接低电平才会启动数据传输,可利用这一点进行多字节数据传输,拉低一次便传输一个字节,这可用作与主设备之间的同步信号。主设备选一根I/O口线作为片选线,将其拉低,执行一次SPI读操作,再拉高,延时一定时间,这时从设备退出从模式,重新往SPIODAT里写新数据及其他一些处理,主设备再将片选线拉低,执行一次SPI读操作。这样便可进行多字节传输了。SPI主从设备通信流程图如图6所示。

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图6 SPI主从设备通信流程图

3.3 终端性能测试

将编译好的界面应用程序下载到终端处理器中并运行,主线程为显示界面,随时可与用户进行信息,两个子线程为读SPI总线线程和串口读写线程,这3个线程同时并行运行。其中GPRS传输部分的界面如图7所示,通过这个显示界面设置串口、上位机IP地址、TCP端口和数据定时发送的时间间隔,发送文本框会显示SPI总线读取的数据值,接收文本框回显GPRS模块返回的信息。上位机用自己的PC机,通过软件soeket tool监听终端发送给上位机数据,实验证明终端界面应用程序工作良好,数据传输也很准确。

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图7 GPRS传输部分的界面

4 结论

系统的上位机接受界面可用VB编写,并建立数据库,方便分析、处理监测现场数据,这部分程序正在完善中。监测终端的数据采集部分采用模块化设计,可以灵活增减,终端软件可以根据不同现场用户自行设计计算公式处理数据,把终端设置好,在上位机通过GPRS网络便可实时监测现场。该检测终端结构灵活,实时性好,适用范围广,具有广泛的应用前景。

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AMD虽然已经宣布了7nm工艺、Zen 2架构的新一代EPYC霄龙处理器,但要到明年才会发布上市,1....

发表于 11-14 11:40 56次 阅读
AMD推出一款EPYC7371 主打高频

新一代酷睿X发烧处理器上市 终于用上高级钎焊散热

10月9日,Intel正式发布了第九代酷睿主流处理器、新一代酷睿X发烧处理器,现在后者终于开始上市了....

发表于 11-14 11:31 68次 阅读
新一代酷睿X发烧处理器上市 终于用上高级钎焊散热

Intel下一代Xeon遭曝光 热设计功耗最高达210W

Intel将在今年底推出代号Cascade Lake-SP的下一代Xeon可扩展处理器,工艺架构不变....

发表于 11-14 11:12 64次 阅读
Intel下一代Xeon遭曝光 热设计功耗最高达210W

i9-9900K评测 主流平台性能王者

稍有资历的DIY玩家应该还记得2006年5月9日那天,Intel第二代酷睿处理器上市所带来的感动(第....

的头像 39度创意研究所 发表于 11-14 10:31 665次 阅读
i9-9900K评测 主流平台性能王者

AMD首次披露第四代架构Zen4 有望达到5nm工艺并在2021年发布

随着AMDZen架构的出现,与英特尔产品线展开更直接的竞争。而AMD 在去年隆重宣布了脱胎换骨的 Z....

发表于 11-13 11:53 159次 阅读
AMD首次披露第四代架构Zen4 有望达到5nm工艺并在2021年发布

A股芯片设计公司北京君正将拿下ISSI的控制权

众所周知,北京君正是中国CPU上市第一股,以出色的低功耗芯片技术和团结的管理团队在业内著称。先前一直....

的头像 澳门威尼斯人官网手机网工程师 发表于 11-13 10:49 524次 阅读
A股芯片设计公司北京君正将拿下ISSI的控制权

AMD官方数据显示Zen2IPC性能将提升近30%

AMD日前正式揭晓了全新设计的Zen 2 CPU架构,将在明年首先应用于第二代EPYC霄龙服务器处理....

发表于 11-13 10:32 108次 阅读
AMD官方数据显示Zen2IPC性能将提升近30%

君正收购ISSI 打造存储新格局

三年前,DRAM厂商ISSI被中资私有化引回国内市场后,关于ISSI的最终去向一直备受行业关注,如今....

的头像 半导体投资联盟 发表于 11-12 17:02 401次 阅读
君正收购ISSI 打造存储新格局

AMD之前就公布Zen2架构的IPC性能变化 比Zen架构提升29%之多

上周的New Horizon发布会上,AMD正式宣布了7nm工艺的CPU及GPU芯片,前者是Zen ....

发表于 11-12 15:42 328次 阅读
AMD之前就公布Zen2架构的IPC性能变化 比Zen架构提升29%之多

CascadeLake-SP家族39款型号参数遭曝光

今年8月份,Intel在Hot Chips大会上宣布了Cascade Lake-SP处理器,即新一代....

发表于 11-12 15:38 65次 阅读
CascadeLake-SP家族39款型号参数遭曝光

Intel宣布48核心96线程处理器 将用于高性能计算和AI相关负载等领域

本周,Intel举办了Supercomputing 2018活动,并宣布了Cascade Lake ....

发表于 11-12 15:35 70次 阅读
Intel宣布48核心96线程处理器 将用于高性能计算和AI相关负载等领域

C语言中程序员编写的头文件和编译器自带的头文件

#include 指令会指示 C 预处理器浏览指定的文件作为输入。预处理器的输出包含了已经生成....

的头像 澳门威尼斯人官网手机网工程师 发表于 11-12 14:55 222次 阅读
C语言中程序员编写的头文件和编译器自带的头文件

Silexica发布了多核软件开发工具SLX的最新版本

SLX for FPGA可对C/C++代码进行深入分析,全面了解软件相互依赖性、应用程序热点以及并行....

的头像 澳门威尼斯人官网手机网工程师 发表于 11-12 14:20 207次 阅读
Silexica发布了多核软件开发工具SLX的最新版本

软考中级嵌入式的详细复习资料免费下载

软考中级嵌入式设计师备考资料 备考笔记 历年真题总结 看完必能每科拿60+详细资料免费下载。

发表于 11-12 08:00 35次 阅读
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太赫兹通信技术是什么中国发展太赫兹高速通信技术有什么作用

太赫兹通信是未来移动通信中极具优势的技术途径,也是空间信息网络高速传输的重要技术手段,具有军民融合、....

的头像 微波射频网 发表于 11-11 10:45 1770次 阅读
太赫兹通信技术是什么中国发展太赫兹高速通信技术有什么作用

关于AMD技术沟通会上都有哪些内容

在处理器市场上,AMD Ryzen对Intel造成的实际压力越来越大。据外媒报道,Mercury R....

的头像 科技美学 发表于 11-10 11:07 478次 阅读
关于AMD技术沟通会上都有哪些内容

网友反馈魅族X8通话有问题,魅族科技创始人表达歉意

核心配置上,魅族X8搭载高通骁龙710处理器,配备LPDDR4X内存,前置2000万像素摄像头,电池....

的头像 科技美学 发表于 11-09 17:31 2173次 阅读
网友反馈魅族X8通话有问题,魅族科技创始人表达歉意

如何使用MSP430设计智能楼宇安检系统论文免费下载

随着科技的发展,模拟前端检测已经成功应用于我们日常生活中。像遥控器、声控灯、安检等等在我们生活中可以....

发表于 11-09 17:15 47次 阅读
如何使用MSP430设计智能楼宇安检系统论文免费下载

DRA791 适用于音频放大器且带 DSP 的 300MHz ARM Cortex-A15 SoC 处理器

DRA79x处理器提供538球,17×17毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel™阵列(VCA)技术,球栅阵列(BGA)封装。 该架构旨在通过经济高效的解决方案为汽车协处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可扩展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娱乐处理器。 可编程性由具有Neon™扩展的单核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮点DSP内核提供。 Arm处理器使开发人员能够将控制功能与DSP和协处理器上编程的其他算法分开,从而降低系统软件的复杂性。 此外,TI还为Arm提供了一整套开发工具, DSP,包括C编译器和用于查看源代码执行的调试接口。 所有设备都提供加密加速。高安全性(HS)设备上提供了所有其他受支持的安全功能,包括对安全启动,调试安全性和对可信执行环境的支持的支持。有关HS设备的更多信息,请联系您的TI代表。 DRA79x Jacinto 6 RSP(无线电声音处理器)设备系列符合AEC-Q100标准。 设备具有简化的电源...

发表于 11-02 19:27 0次 阅读
DRA791 适用于音频放大器且带 DSP 的 300MHz ARM Cortex-A15 SoC 处理器

DRA724 适用于汽车信息娱乐系统的 SoC 处理器

DRA72x(“Jacinto 6 Eco”)信息娱乐应用处理器采用与Jacinto 6设备相同的架构开发,以满足现代信息娱乐系统的强烈处理需求 - DRA72x器件为DRA74x器件提供了向上的可扩展性,同时在整个系列中引脚兼容,允许原始设备制造商(OEM)和原始设计制造商(ODM)快速实现创新连接技术,语音识别,音频流等。 Jacinto 6和Jacinto 6 Eco设备通过完全集成的混合处理器解决方案的最大灵活性带来高处理性能。 可编程性由具有Neon™扩展和TI C66x VLIW浮点DSP内核的单核ARM Cortex-A15 RISC CPU提供。 ARM处理器使开发人员能够将控制功能与DSP和协处理器上编程的其他算法分开,从而降低系统软件的复杂性。 此外,TI还为ARM提供了一整套开发工具, DSP,包括C编译器和用于查看源代码执行情况的调试接口。 DRA72x Jacinto 6 Eco处理器系列符合AEC-Q100标准。 特性 为信息娱乐应用而设计的架构 视频,图像和图形处理支持 全高清视频(1920×1080p,60 fps) 多视频输入和视频输出 2D和3D图形 ARM < sup>® Cortex ® -A15微处理器子系统 C66x浮点VLIW DSP 完全对象代码兼容C67...

发表于 11-02 19:27 0次 阅读
DRA724 适用于汽车信息娱乐系统的 SoC 处理器

DRA780 适用于音频放大器且带 DSP 的 SoC 处理器

DRA78x处理器提供367球,15×15毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel™阵列(VCA)技术,球栅阵列(S-PBGA)封装。 该架构旨在通过经济高效的解决方案为汽车协处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可扩展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娱乐处理器。 此外,TI还为Arm和DSP提供了一整套开发工具,包括C编译器和用于查看源代码执行情况的调试接口。 DRA78x Jacinto 6 RSP (无线电声音处理器)器件系列符合AEC-Q100标准。 该器件具有简化的电源轨映射,可实现低成本的PMIC解决方案。 DRA78x处理器采用Via Channel™阵列(VCA)技术,球栅阵列(S-PBGA)封装,提供367球,15×15 mm,0.65 mm球间距(0.8 mms间距规则可用于信号)。 该架构旨在通过经济高效的解决方案为汽车处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”提供完全可扩展性“),DRA74x”Jacinto 6“,...

发表于 11-02 19:27 0次 阅读
DRA780 适用于音频放大器且带 DSP 的 SoC 处理器

TDA2EG 适用于 ADAS 应用、具有图形/视频加速功能的 SoC 处理器

TI新推出的TDA2Ex片上系统(SoC)是一款高度优化且可扩展的器件系列,旨在满足领先的高级驾驶员辅助系统的要求( ADAS)。 TDA2Ex系列通过集成性能,低功耗和ADAS视觉分析处理的最佳组合,在当今汽车中实现广泛的ADAS应用,旨在促进更自主和无碰撞的驾驶体验。 TDA2Ex SoC通过在单一架构上实现一系列ADAS应用,包括停车辅助,环绕视图和传感器融合,在当今的汽车中实现复杂的嵌入式视觉技术。 TDA2Ex SoC采用了包含混合的异构,可扩展架构TI的固定和浮点TMS320C66x数字信号处理器(DSP)生成内核,ARM Cortex-A15 MPCore™和双Cortex-M4处理器。通过以太网AVB网络集成视频加速器以解码多个视频流,以及用于渲染虚拟视图的图形加速器,实现3D观看体验。 TDA2Ex SoC还集成了许多外设,包括多摄像机接口(并行和串行,包括CSI-2),以支持基于以太网或LVDS的环绕视图系统,显示器和GigB以太网AVB。 此外,TI为ARM和DSP提供了一整套开发工具,包括C编译器,简化编程和调度的DSP汇编优化器,以及用于查看源代码执行情况的调试接口。 TDA2Ex ADAS处理器是符合A...

发表于 11-02 19:27 0次 阅读
TDA2EG 适用于 ADAS 应用、具有图形/视频加速功能的 SoC 处理器

DRA797 适用于音频放大器且带 DSP 的 800MHz ARM Cortex-A15 SoC 处理器

DRA79x处理器提供538球,17×17毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel™阵列(VCA)技术,球栅阵列(BGA)封装。 该架构旨在通过经济高效的解决方案为汽车协处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可扩展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娱乐处理器。 可编程性由具有Neon™扩展的单核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮点DSP内核提供。 Arm处理器使开发人员能够将控制功能与DSP和协处理器上编程的其他算法分开,从而降低系统软件的复杂性。 此外,TI还为Arm提供了一整套开发工具, DSP,包括C编译器和用于查看源代码执行的调试接口。 所有设备都提供加密加速。高安全性(HS)设备上提供了所有其他受支持的安全功能,包括对安全启动,调试安全性和对可信执行环境的支持的支持。有关HS设备的更多信息,请联系您的TI代表。 DRA79x Jacinto 6 RSP(无线电声音处理器)设备系列符合AEC-Q100标准。 设备具有简化的电源...

发表于 11-02 19:27 0次 阅读
DRA797 适用于音频放大器且带 DSP 的 800MHz ARM Cortex-A15 SoC 处理器

DRA712 用于信息娱乐系统和仪表组且带图形功能的 600MHz ARM Cortex-A15 SoC 处理器

DRA71x处理器提供538球,17×17毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel™阵列(VCA)技术,球栅阵列(BGA)封装。 该架构旨在通过经济高效的解决方案为汽车应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”),DRA74x“Jacinto”提供全面的可扩展性6“和DRA72x”Jacinto 6 Eco“系列信息娱乐处理器,包括图形,语音,HMI,多媒体和智能手机投影模式功能。 可编程性由具有Neon™扩展的单核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮点DSP内核提供。 Arm处理器使开发人员能够将控制功能与DSP和协处理器上编程的其他算法分开,从而降低系统软件的复杂性。 此外,TI还为Arm提供了一整套开发工具, DSP,包括C编译器和用于查看源代码执行的调试接口。 所有设备都提供加密加速。高安全性(HS)设备上提供了所有其他受支持的安全功能,包括对安全启动,调试安全性和对可信执行环境的支持的支持。有关HS器件的更多信息,请联系您的TI代表。 DRA71x Jacinto 6入口处理器系列符合AEC-Q100标准。 该器件具有简化的电源轨道映射可实现更低成本的P...

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DRA712 用于信息娱乐系统和仪表组且带图形功能的 600MHz ARM Cortex-A15 SoC 处理器

DRA793 适用于音频放大器且带 DSP 的 500MHz ARM Cortex-A15 SoC 处理器

DRA79x处理器提供538球,17×17毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel™阵列(VCA)技术,球栅阵列(BGA)封装。 该架构旨在通过经济高效的解决方案为汽车协处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可扩展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娱乐处理器。 可编程性由具有Neon™扩展的单核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮点DSP内核提供。 Arm处理器使开发人员能够将控制功能与DSP和协处理器上编程的其他算法分开,从而降低系统软件的复杂性。 此外,TI还为Arm提供了一整套开发工具, DSP,包括C编译器和用于查看源代码执行的调试接口。 所有设备都提供加密加速。高安全性(HS)设备上提供了所有其他受支持的安全功能,包括对安全启动,调试安全性和对可信执行环境的支持的支持。有关HS设备的更多信息,请联系您的TI代表。 DRA79x Jacinto 6 RSP(无线电声音处理器)设备系列符合AEC-Q100标准。 设备具有简化的电源...

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DRA793 适用于音频放大器且带 DSP 的 500MHz ARM Cortex-A15 SoC 处理器

DRA750 适用于信息娱乐应用的双 1.0GHz A15、双 DSP、扩展外设 SoC 处理器

DRA75x和DRA74x(Jacinto 6)信息娱乐应用处理器旨在满足现代信息娱乐系统汽车体验的强烈处理需求。

发表于 11-02 19:27 0次 阅读
DRA750 适用于信息娱乐应用的双 1.0GHz A15、双 DSP、扩展外设 SoC 处理器

DRA725 适用于汽车信息娱乐系统的 SoC 处理器

DRA72x(“Jacinto 6 Eco”)信息娱乐应用处理器采用与Jacinto 6设备相同的架构开发,以满足现代信息娱乐系统的强烈处理需求 - DRA72x器件为DRA74x器件提供了向上的可扩展性,同时在整个系列中引脚兼容,允许原始设备制造商(OEM)和原始设计制造商(ODM)快速实现创新连接技术,语音识别,音频流等。 Jacinto 6和Jacinto 6 Eco设备通过完全集成的混合处理器解决方案的最大灵活性带来高处理性能。 可编程性由具有Neon™扩展和TI C66x VLIW浮点DSP内核的单核ARM Cortex-A15 RISC CPU提供。 ARM处理器使开发人员能够将控制功能与DSP和协处理器上编程的其他算法分开,从而降低系统软件的复杂性。 此外,TI还为ARM提供了一整套开发工具, DSP,包括C编译器和用于查看源代码执行情况的调试接口。 DRA72x Jacinto 6 Eco处理器系列符合AEC-Q100标准。 特性 为信息娱乐应用而设计的架构 视频,图像和图形处理支持 全高清视频(1920×1080p,60 fps) 多视频输入和视频输出 2D和3D图形 ARM < sup>® Cortex ® -A15微处理器子系统 C66x浮点VLIW DSP 完全对象代码与C67x和...

发表于 11-02 19:27 0次 阅读
DRA725 适用于汽车信息娱乐系统的 SoC 处理器

DRA714 适用于信息娱乐系统和仪表组且带图形和数字信号处理器的 600MHz ARM Cortex-A15 SoC 处理器

DRA71x处理器提供538球,17×17毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel™阵列(VCA)技术,球栅阵列(BGA)封装。 该架构旨在通过经济高效的解决方案为汽车应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”),DRA74x“Jacinto”提供全面的可扩展性6“和DRA72x”Jacinto 6 Eco“系列信息娱乐处理器,包括图形,语音,HMI,多媒体和智能手机投影模式功能。 可编程性由具有Neon™扩展的单核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮点DSP内核提供。 Arm处理器使开发人员能够将控制功能与DSP和协处理器上编程的其他算法分开,从而降低系统软件的复杂性。 此外,TI还为Arm提供了一整套开发工具, DSP,包括C编译器和用于查看源代码执行的调试接口。 所有设备都提供加密加速。高安全性(HS)设备上提供了所有其他受支持的安全功能,包括对安全启动,调试安全性和对可信执行环境的支持的支持。有关HS器件的更多信息,请联系您的TI代表。 DRA71x Jacinto 6入口处理器系列符合AEC-Q100标准。 该器件具有简化的电源轨道映射可实现更低成本的P...

发表于 11-02 19:27 0次 阅读
DRA714 适用于信息娱乐系统和仪表组且带图形和数字信号处理器的 600MHz ARM Cortex-A15 SoC 处理器

DRA716 适用于信息娱乐系统和仪表组且带图形和数字信号处理器的 800MHz ARM Cortex-A15 SoC 处理器

DRA71x处理器提供538球,17×17毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel™阵列(VCA)技术,球栅阵列(BGA)封装。 该架构旨在通过经济高效的解决方案为汽车应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”),DRA74x“Jacinto”提供全面的可扩展性6“和DRA72x”Jacinto 6 Eco“系列信息娱乐处理器,包括图形,语音,HMI,多媒体和智能手机投影模式功能。 可编程性由具有Neon™扩展的单核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮点DSP内核提供。 Arm处理器使开发人员能够将控制功能与DSP和协处理器上编程的其他算法分开,从而降低系统软件的复杂性。 此外,TI还为Arm提供了一整套开发工具, DSP,包括C编译器和用于查看源代码执行的调试接口。 所有设备都提供加密加速。高安全性(HS)设备上提供了所有其他受支持的安全功能,包括对安全启动,调试安全性和对可信执行环境的支持的支持。有关HS器件的更多信息,请联系您的TI代表。 DRA71x Jacinto 6入口处理器系列符合AEC-Q100标准。 该器件具有简化的电源轨道映射可实现更低成本的P...

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DRA716 适用于信息娱乐系统和仪表组且带图形和数字信号处理器的 800MHz ARM Cortex-A15 SoC 处理器

DRA782 适用于音频放大器且带双核 DSP 的 SoC 处理器

DRA78x处理器提供367球,15×15毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel™阵列(VCA)技术,球栅阵列(S-PBGA)封装。 该架构旨在通过经济高效的解决方案为汽车协处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可扩展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娱乐处理器。 此外,TI还为Arm和DSP提供了一整套开发工具,包括C编译器和用于查看源代码执行情况的调试接口。 DRA78x Jacinto 6 RSP (无线电声音处理器)器件系列符合AEC-Q100标准。 该器件具有简化的电源轨映射,可实现低成本的PMIC解决方案。 DRA78x处理器采用Via Channel™阵列(VCA)技术,球栅阵列(S-PBGA)封装,提供367球,15×15 mm,0.65 mm球间距(0.8 mms间距规则可用于信号)。 该架构旨在通过经济高效的解决方案为汽车处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”提供完全可扩展性“),DRA74x”Jacinto 6“,...

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DRA782 适用于音频放大器且带双核 DSP 的 SoC 处理器

TDA3MA 具有完备的处理和视觉加速功能且适用于 ADAS 应用的低功耗 SoC

TI的TDA3x片上系统(SoC)是经过高度优化的可扩展系列器件,其设计满足领先的高级驾驶员辅助系统(ADAS)要求.TDA3x系列集最佳性能,低功耗特性和更小的外形尺寸和ADAS视觉分析处理功能于一体,有助于实现更自主的无碰撞驾驶体验,从而在汽车领域中的ADAS应用中得到了广泛的应用。 TDA3x SoC基于单一架构支持行业最广泛的ADAS应用(包括前置摄像头,后置摄像头,环视,雷达和融合技术),在当今汽车领域实现了复杂的嵌入TMS3x SoC采用异类可扩展架构,包含TI的定点和浮点TMS320C66x数字信号处理器(DSP)生成内核,Vision AccelerationPac(EVE)和Cortex-M4双核处理器。视觉技术。 TDA3x SoC采用异类可扩展架构。该器件可采用不同的封装选项(包括叠加封装)实现小外形尺寸设计,从而实现低功耗配置.TDA3x SoC还集成有诸多外设,包括LVDS环视系统的多摄像头接口(并行和串行),显示屏,控制器局域网(CAN)和千兆位以太网视频桥接(AVB)。 适用于本系列产品的Vision AccelerationPac包含嵌入式视觉引擎(EVE),因此应用处理器不用再执行视觉分析功能,同时还降低了能耗。视觉...

发表于 11-02 19:27 0次 阅读
TDA3MA 具有完备的处理和视觉加速功能且适用于 ADAS 应用的低功耗 SoC

DRA781 适用于音频放大器且带 DSP 的 SoC 处理器

DRA78x处理器提供367球,15×15毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel™阵列(VCA)技术,球栅阵列(S-PBGA)封装。 该架构旨在通过经济高效的解决方案为汽车协处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可扩展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娱乐处理器。 此外,TI还为Arm和DSP提供了一整套开发工具,包括C编译器和用于查看源代码执行情况的调试接口。 DRA78x Jacinto 6 RSP (无线电声音处理器)器件系列符合AEC-Q100标准。 该器件具有简化的电源轨映射,可实现低成本的PMIC解决方案。 DRA78x处理器采用Via Channel™阵列(VCA)技术,球栅阵列(S-PBGA)封装,提供367球,15×15 mm,0.65 mm球间距(0.8 mms间距规则可用于信号)。 该架构旨在通过经济高效的解决方案为汽车处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”提供完全可扩展性“),DRA74x”Jacinto 6“,...

发表于 11-02 19:27 0次 阅读
DRA781 适用于音频放大器且带 DSP 的 SoC 处理器

TDA3LX 适用于 ADAS 应用且具有处理、成像与视觉加速功能的低功耗 SoC

TI的TDA3x片上系统(SoC)是经过高度优化的可扩展系列器件,其设计满足领先的高级驾驶员辅助系统(ADAS)要求.TDA3x系列集最佳性能,低功耗特性和更小的外形尺寸和ADAS视觉分析处理功能于一体,有助于实现更自主的无碰撞驾驶体验,从而在汽车领域中的ADAS应用中得到了广泛的应用。 TDA3x SoC基于单一架构支持行业最广泛的ADAS应用(包括前置摄像头,后置摄像头,环视,雷达和融合技术),在当今汽车领域实现了复杂的嵌入TMS3x SoC采用异类可扩展架构,包含TI的定点和浮点TMS320C66x数字信号处理器(DSP)生成内核,Vision AccelerationPac(EVE)和Cortex-M4双核处理器。视觉技术。 TDA3x SoC采用异类可扩展架构。该器件可采用不同的封装选项(包括叠加封装)实现小外形尺寸设计,从而实现低功耗配置.TDA3x SoC还集成有诸多外设,包括LVDS环视系统的多摄像头接口(并行和串行),显示屏,控制器局域网(CAN)和千兆位以太网视频桥接(AVB)。 适用于本系列产品的Vision AccelerationPac包含嵌入式视觉引擎(EVE),因此应用处理器不用再执行视觉分析功能,同时还降低了能耗。视觉...

发表于 11-02 19:27 0次 阅读
TDA3LX 适用于 ADAS 应用且具有处理、成像与视觉加速功能的低功耗 SoC

DRA786 适用于音频放大器且带双核 DSP 和 EVE 的 SoC 处理器

DRA78x处理器提供367球,15×15毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel™阵列(VCA)技术,球栅阵列(S-PBGA)封装。 该架构旨在通过经济高效的解决方案为汽车协处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可扩展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娱乐处理器。 此外,TI还为Arm和DSP提供了一整套开发工具,包括C编译器和用于查看源代码执行情况的调试接口。 DRA78x Jacinto 6 RSP (无线电声音处理器)器件系列符合AEC-Q100标准。 该器件具有简化的电源轨映射,可实现低成本的PMIC解决方案。 DRA78x处理器采用Via Channel™阵列(VCA)技术,球栅阵列(S-PBGA)封装,提供367球,15×15 mm,0.65 mm球间距(0.8 mms间距规则可用于信号)。 该架构旨在通过经济高效的解决方案为汽车处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”提供完全可扩展性“),DRA74x”Jacinto 6“,...

发表于 11-02 19:27 18次 阅读
DRA786 适用于音频放大器且带双核 DSP 和 EVE 的 SoC 处理器

DRA756 Jacinto 汽车电子应用处理器

DRA75x和DRA74x(Jacinto 6)信息娱乐应用处理器旨在满足现代信息娱乐系统汽车体验的强烈处理需求。 最多两个嵌入式视觉引擎(EVE) IVA子系统 显示子系统 使用DMA引擎显示控制器,最多三个管道 HDMI™编码器:符合HDMI 1.4a和DVI 1.0 视频处理引擎(VPE) 2D-Graphics加速器(BB2D)子系统 Vivante ® GC320核心 双核PowerVR ® SGX544 3D GPU 三个视频输入端口(VIP)模块 支持多达10个多路复用输入端口 通用内存控制器(GPMC) 增强型直接内存访问(EDMA)控制器 2端口千兆以太网(GMAC) 十六32 -Bit通用定时器 32位MPU看门狗定时器 五个内部集成电路(I 2 C)端口 HDQ™/1-Wire ®接口 SATA接口 媒体本地总线(MLB)子系统 十个可配置UART /IrDA /CIR模块 四个多通道串行外设接口(McSPI) Quad SPI(QSPI) 八个多通道音频串行端口(McASP)模块 SUPERS peed USB 3.0双重角色设备 三个高速USB 2.0双重角色设备 四个多媒体卡/安全数字/安全数字输入输出接口(MMC™/SD ® /SDIO) PCI-Express ®...

发表于 11-02 19:27 0次 阅读
DRA756 Jacinto 汽车电子应用处理器

SMJ320C6415 定点数字信号处理器

TMS320C64x ?? DSP(包括SMJ320C6414,SMJ320C6415和SMJ320C6416器件)是TMS320C6000中性能最高的定点DSP产品? DSP平台。 TMS320C64x ?? (C64x ?? )设备是基于第二代高性能,先进的VelociTI ??德州仪器(TI)开发的超长指令字(VLIW)架构(VelociTI.2 ??),使这些DSP成为多通道和多功能应用的绝佳选择。 C64x ??是C6000的代码兼容成员?? DSP平台。 C64x器件以720 MHz的时钟速率提供高达57.6亿条指令/秒(MIPS)的性能,可为高性能DSP编程挑战提供经济高效的解决方案。 C64x DSP具有高速控制器的操作灵活性和阵列处理器的数字功能。 C64x ?? DSP内核处理器有64个32位字长的通用寄存器和8个高度独立的功能单元 - 两个乘法器用于32位结果和六个算术逻辑单元(ALU)??用VelociTI.2 ??扩展。 VelociTI.2 ??八个功能单元中的扩展包括新的指令,以加速关键应用程序的性能,并扩展VelociTI的并行性?建筑。 C64x每周期可产生4个32位乘法累加(MAC),总计每秒2400万MAC(MMACS),或每周期8个8位MAC,总计4800 MMACS。 C64x DSP还具有特定于应用的硬件逻...

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SMJ320C6415 定点数字信号处理器

AM5718-HIREL AM5718-HIREL Sitara™ 处理器器件版本 2.0

AM5718-HIREL Sitara ARM应用处理器旨在满足现代嵌入式产品对于处理性能的强烈需求。 AM5718-HIREL器件通过其极具灵活性的全集成混合处理器解决方案,可实现较高的处理性能。此外,这些器件还将可编程的视频处理功能与高度集成的外设集完美融合。 采用配有Neon™扩展组件的单核ARM Cortex-A15 RISC CPU和TI C66x VLIW浮点DSP内核,可提供编程功能。借助ARM处理器,开发人员能够将控制函数与在DSP和协处理器上编程的其他算法分离开来,从而降低系统软件的复杂性。 此外,TI为ARM和C66x DSP提供了一系列完整的开发工具,其中包括C语言编译器,用在简化编程和调度的DSP汇编优化器,可查看源代码执行情况的调试界面等。 AM5718-HIREL Sitara ARM处理器系列符合AEC-Q100标准。 特性 有关器件版本1.0的详细信息,请参阅SPRS919 ARM®Cortex®-A15微处理器子系统 数字信号处理器(DSP) 目标代码与C67x和C64x +完全兼容 每周期最多32次16 x 16位定点乘法 高达512KB的片上L3 RAM 3级(L3)和4级(L4)互连 DDR3 /DDR3L存储器接口(EMIF)模块 ...

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AM5718-HIREL AM5718-HIREL Sitara™ 处理器器件版本 2.0

SM320C6457-HIREL 通信基础设施数字信号处理器

的TMS320C64x +™DSP(包括SM320C6457-HIREL器件)是TMS320C6000DSP平台上的高性能定点DSP系列产品.SM320C6457-HIREL器件基于德州仪器(TI)开发的第3代高性能,高级VelociTI超长指令字(VLIW)架构,这使得该系列DSP非常适合包括视频和电信基础设施,成像/医疗以及无线基础设施(WI)在内的各类应用。 C64x +器件向上代码兼容属于C6000™DSP平台的早期器件。 基于65nm的工艺技术以及凭借高达96亿条指令每秒(MIPS)[或9600 16位MMAC每周期]的性能( 1.2GHz的时钟速率时),SM320C6457-HIREL器件提供了一套应对高性能DSP编程挑战的经济高效型解决方案.SM320C6457-HIREL DSP可以灵活地利用高速控制器以及阵列处理器的数值计算能力。 C64x + DSP内核采用8个功能单元,2个寄存器文件以及2个数据路径。与早期C6000器件一样,其中2个功能单为乘法器或.M单元.C64x内核每个时钟周期执行4次16位×16位乘法累加,相比之下,C64x + .M单元的乘法吞吐量可增加一倍。因此,C64x +内核每个周期可以执行8次16位×16位MAC。采用1.2GHz时钟速率时,这意味着每秒可以执行9600次1...

发表于 11-02 18:48 0次 阅读
SM320C6457-HIREL 通信基础设施数字信号处理器